【FPGA_006】vivado 寄存器为什么会被综合为LUT?？ - 代码天地

【FPGA_006】vivado 寄存器为什么会被综合为LUT?？

其他 2018-07-03 17:38:56 阅读次数: 0

为什么会被综合为LUT?

看着密密麻麻的连线和LUT，我很是纳闷，为什么没有别综合成寄存器？

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转载自blog.csdn.net/weixin_32087301/article/details/80658156

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